¶ CPU IP
¶ 昉·天枢-80
¶ 简述
赛昉科技昉·天枢-80 CPU IP 采用了 9+ 级流水线、三发射、乱序执行的设计，支持丰富的RV64GCBVH RISC-V 指令集。 昉·天枢-80SPECint2006 分数可达 8.0/GHz，专为高能效的计算场景而设，满足移动、桌面、人工智能和汽车应用的需求。
经过预集成与验证， 昉·天枢 -80 简化了 SoC开发工作。 昉·天枢-80 提供具备内存一致性的 Cluster 内单核、双核及四核的配置选择，具有高度可扩展性。
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¶ 昉·天枢-90
¶ 简述
昉·天枢-90 是可交付性能最高的商业级国产RISC-V CPU Core IP，采用 11+ 级流水线、五发射、超标量、深度乱序执行等设计，支持标准 RISC-V RV64GCBH 扩展，同时还针对性能和频率做了深度的优化， SPECint2006 可达 9.4/GHz。 昉·天枢-90 经过预集成及验证，提供具备内存一致性的集群内单核、双核及四核的配置选择，简化了SoC 开发工作，可广泛用于数据中心、PC、移动设备、高性能网络通讯、机器学习等高性能计算场景、设备。
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¶ Interconnect Fabric IP
¶ 昉•星链-500
¶ 简述
昉·星链-500 是赛昉科技首款自研的支持缓存一致性的 Interconnect Fabric IP，支撑构建多核 CPU 和 SoC提供缓存一致性 NoC：连接多个 CPU Cluster、IO 设备和 DDR，并在 SoC 范围内维护缓存的一致性
- 高性能：提供 Last Level Cache (LLC)，提供 Snoop Filter，提高一致性维护模块效率和 Memory Hierarchy性能
- 高效的数据交换：支持 CPU 和 IO 设备共享 LLC，简化 CPU 和 IO 数据交换并提高性能
- 低功耗：支持 LLC Way Shutdown，Cache Retention 等低功耗技术
- 高可靠性：Snoop Filter 和 LLC 支持 SEC-DED (Single Error Correction Double Error Detection)
- 控制接口支持（CFG & MMIO）：CPU 配置 IO 设备和读取片上 SRAM；IO 设备访问和配置一致性片上互联
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¶ 多核系统解决方案
¶ 简述
基于赛昉科技RISC-V CPU IP和Interconnect Fabric IP的多核系统解决方案，构建高性能、高带宽、低延迟的系统解决方案平台。解决方案包括以下组件:
- RISC-V 高性能内核⸺昉·天枢-90
- RISC-V 高能效内核⸺昉·天枢-80
- 高速的支持缓存一致性Interconnect Fabric IP⸺昉·星链-500
- RISC-V Debug Module 调试接口
- RISC-V 中断控制器（PLIC、CLINT）
- 功耗管理、安全性、虚拟化、IO 一致性（IO Coherency）和内存子系统
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